《电子设计套件工具》(Xilinx ISE Design Suite )v12.3/WIN[光盘镜像]
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| [电子设计套件工具].TLF-SOFT-XILINX.ISE.DESIGN.SUITE.v12.3.WIN-EcHoS.iso | 3.21 GB |
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| 3.21 GB | |
电驴资源简介
中文名: 电子设计套件工具英文名: Xilinx ISE Design Suite 资源格式: 光盘镜像版本: v12.3/WIN发行时间: 2010年11月制作发行: Xilinx地区: 美国语言: 英文简介:
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语言:英语
网址:http://www.xilinx.com/tools/designtools.htm
类别:电子设计套件
软件介绍
(from:NET)
Xilinx ISE Design Suite 设计套件是面向 Virtex -6 和 Spartan -6 FPGA 系列并针对生产力精心优化的工具套件,在降低功耗与成本方面取得了突破性进展。作为业界唯一一款特定领域的设计套件,赛灵思最新版本的发布, 是这一行业屡获殊荣的软件不断发展和演进的又一重要一步,它将进一步提高设计生产力和系统性能,使逻辑、嵌入式、数字信号处理 (DSP) 和系统设计人员能够更轻松地推出更复杂的创新型可编程电子产品,从而加速产品上市进程并提升产品质量。
Xilinx ISE Design Suite 12.3 在带来全新的 AXI4 IP 核的同时,加强了 PlanAhead 设计分析导航,并扩展了功耗优化方面的技术支持。
首次发布兼容 AXI4 标准的 IP,支持即插即用型 FPGA 设计
新的 PlanAhead 具备了无缝的“按钮操作”流程,以及高级虚拟化与分析流程
支持 Spartan-6 的智能时钟门控技术,将动态功耗降低了 30%
欢迎立即使用 ISE Design Suite 12.3 展开设计工作,让您的生产力更上一层楼。
ISE DESIGN SUITE 的主要优势:
● 针对 VIRTEX -6 和 SPARTAN -6 FPGA:
● 利用自动时钟门控技术将动态功耗降低30%之多
● 利用第四代部分重配置设计流程降低系统成本
● PlanAhead - 面向逻辑设计人员的新款 RTL 到比特流设计流程
● 利用 AXI4 接口实现即插即用式 FPGA 设计
赛灵思(Xilinx)宣布推出ISE Design Suite 12.3以及多款符合AMBA 4 AXI4规格的智能财产(IP)核心,可支持系统单芯片(SoC)设计中的互连功能模块,并针对PlanAhead Design与软件控制面板(Analysis cockpit)推出生产力提升方案,搭配智能频率闸控功能,以协助客户降低在现场可编程逻辑器件(FPGA)设计中的动态功耗。
赛灵思公司全球营销部资深副总裁Vin Ratford表示,赛灵思支持即插即用FPGA设计模式互连策略,针对AMBA 4规格推行标准化,AXI4互连技术具备弹性,能针对效能与空间进行调整,让客户能能更轻松地整合来自不同领域以及不同供货商的IP。
赛灵思推行AMBA 4 AXI4规格,透过即插即用的FPGA设计来支持,客户将可获得一套一致性方案来串连IP模块,并可透过使用与重复利用IP,更加妥善运用设计资源,更轻松整合各IP供货商的方案。ISE Design Suite 12.3版本包含各种强化功能,针对CORE Generator工具,提供连接高度参数化的IP以节省设计时间及能让研发业者快速配置其系统架构、总线、外围组件的赛灵思Platform Studio与System Generstor工具。
安谋国际(ARM)公司处理器部门营销总监Michael Dimelow表示,各种新设计规模日趋复杂,意谓通讯及互连对系统效能影响甚巨;通过AMBA标准的开放特性,可藉由在各种SoC与FPGA的建置中扩充多元化的可用IP,进而加快产品上市时程,为系统设计人员提供众多好处。
ISE Design Suite 软件的PlanAhead 设计工具提供无缝式「按钮操控」流程,以及更先进的可视化与分析流程。ISE Design Suite 12.3现已推出可支持所有ISE版本的方案,Logic Edition专属版售价从2995美元起。客户可至赛灵思网站免费下载30天全功能评测版,AMBA 4 第一阶段的规格包括AXI4、AXI4-Lite、以及AXI4-Stream。
摘自xuehui @TLF
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| The ISE Design Suite 12 software unlocks greater design |
| productivity with breakthrough technologies for power |
| optimization and easier IP integration. |
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| More Information |
| http //www.xilinx.com/tools/designtools.htm |
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| 1. Unpack Burn/Mount |
| 2. Follow instructions in EcHoS dir. EnjoY! |
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| G R O U P N E W S G R E E T I N G S |
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| | Special greetings go out to | |
| | HLS REVEiLLE AG ANiHLS GRB | |
| | SCREAM NO NITROUS BRD DVT | |
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| | We are currently looking for | |
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| | * Good crackers | |
| | * Experienced coders/scripters | |
| | * Suppliers of quality software who can do so | |
| | on a frequent basis | |
| | * Fast distros for exclusive EcHoS usage | |
| | * Fast shells | |
| | * Love and Support.. | |
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| | PS.Seems we're back babe! | |
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| | E c H o S 2 0 1 0 | |
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引用下载链接来自TLF
未经过安装测试与安全检测,使用者后果自负与本论坛无关
软件版权归原作者及其公司所有,如果你喜欢,请购买正版
引用 资源来自网络收集 未经过一一的质量 安全等检测
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语言:英语
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Xilinx ISE Design Suite 设计套件是面向 Virtex -6 和 Spartan -6 FPGA 系列并针对生产力精心优化的工具套件,在降低功耗与成本方面取得了突破性进展。作为业界唯一一款特定领域的设计套件,赛灵思最新版本的发布, 是这一行业屡获殊荣的软件不断发展和演进的又一重要一步,它将进一步提高设计生产力和系统性能,使逻辑、嵌入式、数字信号处理 (DSP) 和系统设计人员能够更轻松地推出更复杂的创新型可编程电子产品,从而加速产品上市进程并提升产品质量。
Xilinx ISE Design Suite 12.3 在带来全新的 AXI4 IP 核的同时,加强了 PlanAhead 设计分析导航,并扩展了功耗优化方面的技术支持。
首次发布兼容 AXI4 标准的 IP,支持即插即用型 FPGA 设计
新的 PlanAhead 具备了无缝的“按钮操作”流程,以及高级虚拟化与分析流程
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● 针对 VIRTEX -6 和 SPARTAN -6 FPGA:
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● 利用第四代部分重配置设计流程降低系统成本
● PlanAhead - 面向逻辑设计人员的新款 RTL 到比特流设计流程
● 利用 AXI4 接口实现即插即用式 FPGA 设计
赛灵思(Xilinx)宣布推出ISE Design Suite 12.3以及多款符合AMBA 4 AXI4规格的智能财产(IP)核心,可支持系统单芯片(SoC)设计中的互连功能模块,并针对PlanAhead Design与软件控制面板(Analysis cockpit)推出生产力提升方案,搭配智能频率闸控功能,以协助客户降低在现场可编程逻辑器件(FPGA)设计中的动态功耗。
赛灵思公司全球营销部资深副总裁Vin Ratford表示,赛灵思支持即插即用FPGA设计模式互连策略,针对AMBA 4规格推行标准化,AXI4互连技术具备弹性,能针对效能与空间进行调整,让客户能能更轻松地整合来自不同领域以及不同供货商的IP。
赛灵思推行AMBA 4 AXI4规格,透过即插即用的FPGA设计来支持,客户将可获得一套一致性方案来串连IP模块,并可透过使用与重复利用IP,更加妥善运用设计资源,更轻松整合各IP供货商的方案。ISE Design Suite 12.3版本包含各种强化功能,针对CORE Generator工具,提供连接高度参数化的IP以节省设计时间及能让研发业者快速配置其系统架构、总线、外围组件的赛灵思Platform Studio与System Generstor工具。
安谋国际(ARM)公司处理器部门营销总监Michael Dimelow表示,各种新设计规模日趋复杂,意谓通讯及互连对系统效能影响甚巨;通过AMBA标准的开放特性,可藉由在各种SoC与FPGA的建置中扩充多元化的可用IP,进而加快产品上市时程,为系统设计人员提供众多好处。
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